ALTERA说明书大全
ALTERA Avalon Verification IP Suite 用户指南
该文档介绍了Altera Avalon Verification IP Suite的功能，包括优势和功能特性，以及如何使用它
文件类型: PDF 大小:4321 KB
ALTERA Arria V Hard IP for PCI Express 用户指南
本文档是Arria V Hard IP for PCI Express的用户指南，介绍了该产品的特点和特性。
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ALTERA Altera Transceiver PHY IP Core 用户指南
该文档是Alter公司的Transceiver PHY IP核的用户指南，介绍了该IP核的特点和特性。
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ALTERA 10-Gbps Ethernet MAC MegaCore Function 用户指南
10-Gbps Ethernet MAC MegaCore Function User Guide，介绍了10-Gbps Ethernet MAC MegaCore Function 的使用方法和注意事项。
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ALTERA Nios II Custom Instruction 用户指南
Nios II 自定义指令用户指南介绍了如何在 Nios II 处理器上使用自定义指令，并提供了有关编写、汇编、链接和下载自定义指令的详细信息。
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ALTERA MAX 9000 数据手册
MAX 9000 可编程逻辑器件系列是一款基于第三代多阵列矩阵 (MAX®) 架构的高性能 CMOS EEPROM 可编程逻辑器件 (PLD)。
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ALTERA MAX 7000 数据手册(2)
MAX 7000 是 Altera 公司生产的一种高性能 EEPROM 可编程逻辑器件 (PLD)，基于第二代 MAX 架构。MAX 7000 系列器件具有 5.0 V 的 in-system programmability (ISP)，通过内置的 IEEE Std. 1149.1 Joint Test Action Group (JTAG) 接口，并且该 ISP 电路符合 IEEE Std. 1532 标准。MAX 7000 系列包括 5.0 V MAX 7000 器件和 5.0 V ISP 基于的 MAX 7000S 器件。MAX 7000S 器件中具有 128 个或更多宏单元时，具有内置的 JTAG 边界扫描测试 (BST) 电路。MAX 7000 系列器件具有从 600 个到 5,000 个可用门的逻辑密度，并且具有 5 ns 的引脚到引脚的逻辑延迟，可实现高达 175.4 MHz 的计数器频率 (包括互连)。PCI 兼容器件可用。
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ALTERA MAX 7000 数据手册(1)
MAX 7000是Altera公司推出的一种高性能、EEPROM-based的PLD，基于第二代MAX架构。该系列器件包括5.0V的MAX 7000和5.0V ISP-based MAX 7000S器件。该系列器件具有5ns的pin-to-pin逻辑延迟，最高可达175.4MHz的计数器频率。
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ALTERA MAX 7000A 数据手册(3)
MAX 7000A是Altera公司生产的一款高性能3.3V EEPROM-based可编程逻辑器件（PLD），其架构是第二代Multiple Array MatriX (MAX)，支持3.3V in-system programmability (ISP)，以及IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface，具有advanced pin-locking capability。此外，MAX 7000AE device in-system programmability (ISP) circuitry compliant with IEEE Std. 1532，而EPM7128A和EPM7256A device ISP circuitry compatible with IEEE Std. 1532。MAX 7000A还支持JEDEC Jam Standard Test and Programming Language (STAPL) JESD-71。
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Altera Corporation EPM7064 & EPM7064S Dedicated Pin-Outs ver. 1.0 技术资料
该文件介绍了Altera Corporation的EPM7064和EPM7064S产品的引脚布局和输入/输出引脚的详细信息。
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ALTERA MAX 7000A 数据手册(2)
MAX 7000A是Altera公司推出的一款高性能3.3-V EEPROM-based programmable logic devices (PLDs)，基于第二代Multiple Array MatriX (MAX®)架构，具有3.3-V in-system programmability (ISP)，并通过内置的IEEE Std. 1149.1 Joint Test Action Group (JTAG)接口实现了先进的pin-locking capability，还支持IEEE Std. 1149.1 compliant built-in boundary-scan test (BST) circuitry和JEDEC Jam Standard Test and Programming Language (STAPL) JESD-71等技术
文件类型: PDF 大小:1861 KB
ALTERA MAX 7000A 数据手册(1)
MAX 7000AE是一种高性能的3.3V EEPROM可编程逻辑器件(PLD)，采用第二代多阵列矩阵(MAX)架构。它支持3.3V的现场可编程性(ISP)，具有内置的IEEE Std. 1149.1 Joint Test Action Group (JTAG)接口和较强的针脚锁定能力。该器件还具有内置的边界扫描测试(BST)电路，支持JEDEC Jam Standard Test and Programming Language (STAPL) JESD-71。它与5.0V的MAX 7000S器件针脚兼容，可提供从600到10,000个可用门的高密度PLD。
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Altera Corporation EPM3512A Dedicated Pin-Outs ver. 1.0 技术资料
该文档介绍了EPM3512A芯片的引脚分配。EPM3512A是一款具有208引脚PQFP封装和256引脚FineLine BGA封装的芯片。文档提供了不同引脚的功能和连接信息。
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Altera Corporation EPM3128A Dedicated Pin-Outs ver. 2.0 技术资料
This is the pin-out information of EPM3128A.
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